ABSTRAKSI: Ide dalam mengambil judul “Perancangan dan Realisasi Prototype Receiver TDMA-FDD Pada Master dan Slave Station Dalam Level Intermediate frekuensi” dalam tugas akhir ini dilatarbelakangi oleh keinginan untuk membuat miniatur perangkat telekomunikasi secara hardware dan software yang bisa untuk dipelajari, dikembangkan dan disimulasikan lebih lanjut. Dalam realisasinya nanti sangat diharapkan perangkat ini nantinya dapat bekerja sama dengan bagian transmitter master dan slave station untuk mewujudkan hubungan akses antar slave dan slave dengan master berdasarkan mekanisme penjadwalan untuk data yang diatur oleh master station (TDMA-FDD reservasi).
Yang menjadi bagian permasalahan utama dalam tugas akhir ini adalah bagaimana realisasi miniatur perangkat TDMA-FDD ini bekerja sesuai mekanisme penjadwalan layaknya di lapangan. Dimana di lapangan, sistem TDMA-FDD bekerja dengan kondisi minimum 1 master station untuk sekian banyak slave station di sekitarnya. Master berfungsi sebagai pihak pemberi jadwal, sedangkan slave station sebagai pihak peminta dan penerima jadwal hubungan. Dalam hubungannya master bekerja dengan frekuensi yang berbeda dari slave station, namun sesama slave bekerja dalam frekuensi yang sama beda giliran bicara. Dari permasalahan tersebut, maka sekurang-kurangnya perlu direalisasikan sistem yang mampu membuktikan terjadinya hubungan minimal untuk 1 master station dan 2 slave station sebagai jalan pembuktian berjalannya mekanisme penjadwalan.
Namun pada akhir pengerjaan, kami menemui banyak kendala diakibatkan oleh minimnya keahlian dibidang elektronika praktis, sehingga dari sekian banyak rancangan tahap awal hanya bagian perhitungan dan simulasi PLL sebagai demodulator yang berhasil dikerjakan secara software menggunakan mathlab dan circuit maker untuk simulasi osilatornya. Selanjutnya demi menyelesaikan tugas akhir, kami berpindah ke penggunaan IC yang berarti penurunan besar frekuensi dari 8 & 12 MHz ke 80 & 240 kHz yang berhasil kami realisasikan sampai tahapan modem FSK dan mixer. Sedangkan mikrokontroller bagian Master dan Slave sebagai otak perangkat ini masih harus dibenahi lebih lanjut dalam rangka memenuhi konsep TDMA-FDD reservasi sebenarnya. Oleh karena itu kemudian tugas akhir ini akan saya sampaikan dengan segala hasil yang telah saya capai ditambah dengan analisa pada setiap titik kegagalan.Kata Kunci : ABSTRACT: Idea to take this topic “Design and Realization Prototype Receiver TDMA-FDD At The Master and Slave Station In the Intermediate Frequency Level” in this final task are fully push by my own desperate to make some miniature of telecommunication hardware and software that can be used as tools for supporting anyone that want to learn and developed those topic by simulating the miniature. In my realization, I’d really hope the miniature that I have made can work together and supporting each other with transmitter at the master and slave station that been made by other person friend of mine to realize harmony relationship between slave and slave or slave with master station with TDMA-FDD reservation mechanism.
The main problems in this final task are of course how to realize the miniature of TDMA-FDD that really works as the same as in the reality. Where in the reality, this system must work with minimum 1 master and 2 slave station. Master as the schedule maker and slave as the object of the decision schedule that been made by master station. In the truly TDMA-FDD communication, Master station work with different frequency with the Slave station, but each Slave station work with the same frequency. And to prove those reality, then I should make minimum 2 slave station and 1 master station.
Although I’ve planned so far to close on reality, but still I can’t finished it yet. With all my ability, I only finished the master plan by each blok simulation, and realize demodulator FSK down to 80 & 240 kHz from 8 & 12 MHz and still with the failled function of microcontroller as the main brain of my hardware. So, here I came with all that I’ve been done and all my analysis on all my fail point.Keyword: